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标题: 超频的相关问题 [打印本页]

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作者: liruome    时间: 2008-4-11 00:24
标题: 超频的相关问题
<><FONT face=宋体 color=#000000><STRONG>PLLCLK = 2 x OSCCLK x [SYNR + 1]/[REFDV + 1]，</STRONG></FONT></P><P>而BUS CLOCK是由PLLCLK二分频得到的，即BUS CLOCK ＝ PLLCLK/2 </P><P>当你选择倍频时（PLLSEL＝1），你的系统频率是等于锁相环频率(PLLCLK)，</P><P>当你不选择倍频时（PLLSEL＝0），你的系统频率是等于振荡器频率(OSCCLK)</P><P>而你的总线频率（Bus Clock）是始终等于你系统频率的1/2。</P><P>PLLCLK的极限频率大概是多少？<STRONG>Bus Clock=0.5*PLLCLK&nbsp;&nbsp;&nbsp;&nbsp; （PLLSEL＝1时），</STRONG></P><P><U><STRONG>是不是Bus Clock最大极限为48MHz?</STRONG></U>&nbsp;&nbsp; <STRONG>Bus Clock为40<U>MHz</U>时能不能稳定运行???</STRONG></P>

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作者: levichen    时间: 2008-4-11 01:10
标题: Re:超频的相关问题
40MHz的话勉强可以<br>

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作者: Roacher    时间: 2008-4-11 19:13
标题: Re:超频的相关问题
&nbsp; 应该也不用超那么多的，到32会比较稳

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作者: walkshow    时间: 2010-3-29 09:38
不是说超到96都可以的嘛，不过我觉得算法精简才是关键哦

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作者: myb396    时间: 2010-4-23 18:50
同意楼上的说法
尽量从算法上来改进

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作者: myb396    时间: 2010-4-23 18:50
同意楼上的说法
尽量从算法上来改进

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作者: myb396    时间: 2010-4-23 18:50
同意楼上的说法
尽量从算法上来改进

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作者: myb396    时间: 2010-4-23 18:50
同意楼上的说法
尽量从算法上来改进

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作者: myb396    时间: 2010-4-23 18:50
同意楼上的说法
尽量从算法上来改进

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作者: 寻找钢叉的猹    时间: 2013-5-10 23:13

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