(LPLD)求助，关于总线时钟

m__dd · 发表于 2013-6-23 17:52:42

      目的是超频至内核200，总线100，flexbus100，flash25；
第一步：#define CORE_CLK_MHZ       PLL_200
第二步：将拉普兰德原库函数：LPLD_Set_SYS_DIV(0,3,3,7);  //core=200M, bus=50M, FlexBus=50M, Flash Clk=25M
   /***++++++++++++++++++++++++修改后++++++++++++++++++++++++++++***/
   修改为： LPLD_Set_SYS_DIV(0,1,1,7);  //core=200M, bus=100M, FlexBus=100M, Flash Clk=25M
结果：（1）若我全速运行  错误如图123。（疑问：core_clk_mhz = 200，SIM_CLKDIV1 = 18284544 = 0x1170000；对应outdiv1 = 0，outdiv2 = 1；outdiv3 = 1；outdiv4 = 7；怎么会错误？）
      （2）若我单步运行，或在时钟配置时设置断点，正常，如图456

知~行 · 发表于 2014-3-6 14:41:00

主频超到180应该没问题！

projecta · 发表于 2014-1-15 23:41:23

m__dd · 发表于 2014-1-7 10:53:51

記得灬初戀。发表于 2014-1-6 12:13

老帖子了

記得灬初戀。 · 发表于 2014-1-6 12:13:37

小七^^ · 发表于 2014-1-5 19:49:59

a1193427921 · 发表于 2013-12-20 09:37:23

neuq1234567 · 发表于 2013-10-15 10:12:44

luyu · 发表于 2013-10-14 12:59:09

小橙子 · 发表于 2013-10-4 10:21:00

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