智能车制作

 找回密码
 注册

扫一扫,访问微社区

查看: 1453|回复: 1
打印 上一主题 下一主题

关于FPGA内核RAM的管脚问题

[复制链接]

8

主题

9

帖子

0

精华

注册会员

Rank: 2

积分
155
威望
93
贡献
36
兑换币
33
注册时间
2015-1-24
在线时间
13 小时
毕业学校
西电
跳转到指定楼层
1#
发表于 2015-6-10 10:01:13 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
现有一电路,fifo连接FPGA,由fifo出来的数据直接送给FPGA,但是因为数字信号不好观察,因此想通过FPGA里面的RAM存储数据,然后后面模拟一个DA,观察信号。问题是RAM核的地址管脚和时钟管脚应该怎么连接?
回复

使用道具 举报

11

主题

242

帖子

0

精华

跨届大侠

Rank: 10Rank: 10Rank: 10

积分
6027
威望
3018
贡献
1889
兑换币
1340
注册时间
2011-8-6
在线时间
560 小时
2#
发表于 2015-6-10 18:31:34 | 只看该作者
如果你用的是altera的FPGA可以直接使用signal tap II进行观测
回复 支持 反对

使用道具 举报

您需要登录后才可以回帖 登录 | 注册

本版积分规则

关于我们|联系我们|小黑屋|智能车制作 ( 黑ICP备2022002344号

GMT+8, 2024-9-20 20:27 , Processed in 0.038936 second(s), 25 queries , Gzip On.

Powered by Discuz! X3.2

© 2001-2013 Comsenz Inc.

快速回复 返回顶部 返回列表