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在PLL程序中死循环了

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发表于 2009-4-18 00:26:57 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
在程序中怎么都死住了,应该是在while(CRGFLG_LOCK!=1);这里没办法跳过,大家有遇见同样的问题么?


REFDV=0x03;//Divide OSCCLK by REFDV+1=4,REFCLK=16M
SYNR=0x09;//Multiply by SYNR+1=10,PLLCLK=2*16M*10/4=80M
while(CRGFLG_LOCK!=1);//Wait Till VCO Run Stable
CLKSEL_PLLSEL=0x01;//PLLCLK Enabled,Bus Clock=PLLCLK/2=40M      //////////////////////////
FCLKDIV=0x0F;//Flash Clock Divide Factor 16M/16=1M

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发表于 2009-4-18 15:13:04 | 只看该作者
本帖最后由 whut_wj 于 2009-4-18 15:14 编辑

while(CRGFLG_LOCK!=1);
这个是时钟倍频之后等待时钟同步,是PLL提供总线时钟的保证。
这句话通不过就明倍频没成功
对于老单核单片机来说,特别是DT系更的,40M倍频有些问题。

检查DG128的晶振及倍频外围配置,要么重新制板。

你的这个情况应该是出现在DG128里的,XS128的倍频外围配置简单。
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 楼主| 发表于 2009-4-20 21:42:18 | 只看该作者
2# whut_wj


谢啦~~
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