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[编程类] 什么是PLL?

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发表于 2011-2-15 17:06:47 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式
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//------------------------MCU 初始化,外部晶振16M,总线频率为40M ---------------------------
void MCUInit(void)
{
//(1)禁止总中断
DisableInterrupts;
//(2)CLKSEL 的第七位置0,选择的时钟源是OSCCLK
//在PLL 程序执行前,内部总线频率=OSCCLK/2
//CLKSEL-7 决定内部总线时钟来源
// =0:BUSCLOCK=OSCCLK/2; =1:BUSCLOCK=PLLCLK/2
CLKSEL &=0X7F; //此时BUSCLOCK=OSCCLK/2
//(3)禁止PLL
PLLCTL &=0XBF; //先关PLL
//(4)根据需要的时钟频率设置SYNR 和REFDV 寄存器
//计算公式:(xs128)PLLCLK==2*OSCCLK*((SYNR+1)/(REFDV+1))
//计算公式: BUSCLK=PLLCLK/2
SYNR=0X44; //对PLL 增频
REFDV=0X81; //对PLL 分频
//(5)开PLL
PLLCTL |=(1<<6);
//(6)通过判断CRGFLG 寄存器的LOCK 位,确定PLL 是否稳定
while((CRGFLG&0X08)==0X00);
//(7)时钟频率稳定后,允许锁相环时钟源作为系统时钟
CLKSEL |=(1<<7); //本句执行后:BUSCLOCK=PLLCLK/2

最佳答案

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控制单片机总线时钟的模块。总线时钟的可以有两路输入,一是晶振,意识锁相环。锁相环可以使总线时钟更稳定,还可以设置自己需要的频率。不用太深究,写程序时一开始把寄存器都设好就不用管它了。具体设置看手册,也可以看看这本书《freescale 9s12 十六位单片机原理及嵌入式开发技术》,机械工程出版社。

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发表于 2011-2-15 17:06:48 | 只看该作者
控制单片机总线时钟的模块。总线时钟的可以有两路输入,一是晶振,意识锁相环。锁相环可以使总线时钟更稳定,还可以设置自己需要的频率。不用太深究,写程序时一开始把寄存器都设好就不用管它了。具体设置看手册,也可以看看这本书《freescale 9s12 十六位单片机原理及嵌入式开发技术》,机械工程出版社。
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发表于 2011-2-18 18:41:57 | 只看该作者
PLL是锁相环,一般用来倍频总线频率。
因为晶振频率是固定的,通过PLL可以改变总线的频率
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发表于 2011-2-18 19:08:16 | 只看该作者
就是上面说的那样啊,不知道怎么还标明未解决啊?
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发表于 2011-2-18 19:11:38 | 只看该作者
回复 2# bhwxl


    这本书有电子版没?
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发表于 2011-2-19 20:42:01 | 只看该作者
回复 5# qingpingpei


    不知道,我是买的。关于freescale单片机的书很少,我在中关村图书大厦搜索这个词就4条结果...
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发表于 2011-2-20 15:59:22 | 只看该作者
PLL: 为锁相回路,用来统一整合时脉讯号,使内存能正确的存取资料。
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发表于 2011-2-21 15:20:35 | 只看该作者
是倍频,有整数和分数
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发表于 2011-3-5 10:25:34 | 只看该作者
不错,知道是设置更高的总线时钟频率就可以了
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发表于 2011-8-24 12:42:36 | 只看该作者
好。。
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